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A Design-for-Verification Technique for Debugging HDL Designs
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後設資料
資料識別:
A05005727
資料類型:
期刊論文
著作者:
Liu, Jimmy Chien-nan
主題與關鍵字:
Verification Debugging HDL RTL Design-for-verification
描述:
來源期刊:International Journal of Electrical Engineering
卷期:12:1 民94.02
頁次:頁99-104
日期:
20050200
來源:
臺灣期刊論文索引系統
管理權:
國家圖書館
授權聯絡窗口
管理單位:知識服務組-期刊
聯絡E-mail:nclper@ncl.edu.tw
電話:02-23619132轉305
引用這筆典藏
引用資訊
Liu, Jimmy Chien-nan(20050200)。[A Design-for-Verification Technique for Debugging HDL Designs]。《數位典藏與數位學習聯合目錄》。http://catalog.digitalarchives.tw/item/00/4b/f3/7d.html(2024/09/14瀏覽)。
直接連結
http://catalog.digitalarchives.tw/item/00/4b/f3/7d.html
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